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Informazioni sulla famiglia
- Soluzione di programmazione/debug JTAG di dimensioni ridotte, completa, all-in-one per FPGA Xilinx
- Compatibile con tutti gli strumenti Xilinx
Normativa e conformità
Informazioni sull'articolo
L'HS3 costruisce si basa sul JTAG-HS1 di successo, aggiungendo un buffer open drain a 14 pin, per consentire il debugging dei processori SOC Xilinx Zynq. Quando è collegato a un PC tramite un cavo da A a micro USB standard, il JTAG HS3 riceve alimentazione da USB e può essere riconosciuto come cavo di programmazione Digilent, anche se l'HS3 non è collegato alla scheda di destinazione. Il bus JTAG può essere condiviso con altri dispositivi poiché i segnali dell'HS3 vengono mantenuti in alta impedenza, eccetto quando vengono guidati attivamente durante la programmazione. L'HS3 è piccolo e leggero e può essere tenuto fermo al suo posto dal connettore della scheda di sistema.